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DS257F2
CS4362
SWITCHING CHARACTERISTICS - CONTROL PORT - SPI FORMAT
(For KQZ TA = -10°C to +70°C; VLC = 1.8 V to 5.5 V; Inputs: Logic 0 = GND, Logic 1 = VLC, CL =30pF)
Notes:
22. tspi only needed before first falling edge of CS after RST rising edge. tspi = 0 at all other times.
23. Data must be held for sufficient time to bridge the transition time of CCLK.
24. For FSCK < 1 MHz.
Parameter
Symbol
Min
Max
Unit
CCLK Clock Frequency
fsclk
-
MHz
RST Rising Edge to CS Falling
tsrs
500
-
ns
CCLK Edge to CS Falling
(Note 22)
tspi
500
-
ns
CS High Time Between Transmissions
tcsh
1.0
-
s
CS Falling to CCLK Edge
tcss
20
-
ns
CCLK Low Time
tscl
-ns
CCLK High Time
tsch
-ns
CDIN to CCLK Rising Setup Time
tdsu
40
-
ns
CCLK Rising to DATA Hold Time
(Note 23)
tdh
15
-
ns
Rise Time of CCLK and CDIN
(Note 24)
tr2
-
100
ns
Fall Time of CCLK and CDIN
(Note 24)
tf2
-
100
ns
MCLK
2
-----------------
1
MCLK
-----------------
1
MCLK
-----------------
t r2
t f2
t dsu t dh
t sch
t scl
CS
CCLK
CDIN
t css
t csh
t spi
t srs
RST
Figure 4. Control Port Timing - SPI Format
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